PCI: dwc: Move dw_pcie_msi_init() into core
authorRob Herring <robh@kernel.org>
Thu, 5 Nov 2020 21:11:54 +0000 (15:11 -0600)
committerLorenzo Pieralisi <lorenzo.pieralisi@arm.com>
Thu, 19 Nov 2020 10:51:41 +0000 (10:51 +0000)
The host drivers which call dw_pcie_msi_init() are all the ones using
the built-in MSI controller, so let's move it into the common DWC code.

Link: https://lore.kernel.org/r/20201105211159.1814485-12-robh@kernel.org
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14 files changed:
drivers/pci/controller/dwc/pci-dra7xx.c
drivers/pci/controller/dwc/pci-exynos.c
drivers/pci/controller/dwc/pci-imx6.c
drivers/pci/controller/dwc/pci-meson.c
drivers/pci/controller/dwc/pcie-artpec6.c
drivers/pci/controller/dwc/pcie-designware-host.c
drivers/pci/controller/dwc/pcie-designware-plat.c
drivers/pci/controller/dwc/pcie-designware.h
drivers/pci/controller/dwc/pcie-histb.c
drivers/pci/controller/dwc/pcie-kirin.c
drivers/pci/controller/dwc/pcie-qcom.c
drivers/pci/controller/dwc/pcie-spear13xx.c
drivers/pci/controller/dwc/pcie-tegra194.c
drivers/pci/controller/dwc/pcie-uniphier.c

index 054423d..72a5a2b 100644 (file)
@@ -182,8 +182,6 @@ static int dra7xx_pcie_host_init(struct pcie_port *pp)
        struct dra7xx_pcie *dra7xx = to_dra7xx_pcie(pci);
 
        dw_pcie_setup_rc(pp);
-
-       dw_pcie_msi_init(pp);
        dra7xx_pcie_enable_interrupts(dra7xx);
 
        return 0;
index 6498b61..3939fe2 100644 (file)
@@ -273,12 +273,8 @@ static irqreturn_t exynos_pcie_irq_handler(int irq, void *arg)
 
 static void exynos_pcie_msi_init(struct exynos_pcie *ep)
 {
-       struct dw_pcie *pci = ep->pci;
-       struct pcie_port *pp = &pci->pp;
        u32 val;
 
-       dw_pcie_msi_init(pp);
-
        /* enable MSI interrupt */
        val = exynos_pcie_readl(ep->mem_res->elbi_base, PCIE_IRQ_EN_LEVEL);
        val |= IRQ_MSI_ENABLE;
index 1fe8f3f..9e30fbf 100644 (file)
@@ -835,7 +835,6 @@ static int imx6_pcie_host_init(struct pcie_port *pp)
        imx6_pcie_deassert_core_reset(imx6_pcie);
        imx6_setup_phy_mpll(imx6_pcie);
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
 
        return 0;
 }
index 41a3351..2df0adc 100644 (file)
@@ -381,7 +381,6 @@ static int meson_pcie_host_init(struct pcie_port *pp)
        meson_set_max_rd_req_size(mp, MAX_READ_REQ_SIZE);
 
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
 
        return 0;
 }
index 8b3da30..7ee8f3c 100644 (file)
@@ -329,7 +329,6 @@ static int artpec6_pcie_host_init(struct pcie_port *pp)
        artpec6_pcie_deassert_core_reset(artpec6_pcie);
        artpec6_pcie_wait_for_phy(artpec6_pcie);
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
 
        return 0;
 }
index 800e7a0..ebea2c8 100644 (file)
@@ -256,7 +256,7 @@ int dw_pcie_allocate_domains(struct pcie_port *pp)
        return 0;
 }
 
-void dw_pcie_free_msi(struct pcie_port *pp)
+static void dw_pcie_free_msi(struct pcie_port *pp)
 {
        if (pp->msi_irq) {
                irq_set_chained_handler(pp->msi_irq, NULL);
@@ -275,19 +275,18 @@ void dw_pcie_free_msi(struct pcie_port *pp)
        }
 }
 
-void dw_pcie_msi_init(struct pcie_port *pp)
+static void dw_pcie_msi_init(struct pcie_port *pp)
 {
        struct dw_pcie *pci = to_dw_pcie_from_pp(pp);
        u64 msi_target = (u64)pp->msi_data;
 
-       if (!IS_ENABLED(CONFIG_PCI_MSI))
+       if (!pci_msi_enabled() || !pp->has_msi_ctrl)
                return;
 
        /* Program the msi_data */
        dw_pcie_writel_dbi(pci, PCIE_MSI_ADDR_LO, lower_32_bits(msi_target));
        dw_pcie_writel_dbi(pci, PCIE_MSI_ADDR_HI, upper_32_bits(msi_target));
 }
-EXPORT_SYMBOL_GPL(dw_pcie_msi_init);
 
 int dw_pcie_host_init(struct pcie_port *pp)
 {
@@ -423,6 +422,8 @@ int dw_pcie_host_init(struct pcie_port *pp)
                        goto err_free_msi;
        }
 
+       dw_pcie_msi_init(pp);
+
        if (!dw_pcie_link_up(pci) && pci->ops->start_link) {
                ret = pci->ops->start_link(pci);
                if (ret)
index adebcae..dec24e5 100644 (file)
@@ -36,7 +36,6 @@ static const struct of_device_id dw_plat_pcie_of_match[];
 static int dw_plat_pcie_host_init(struct pcie_port *pp)
 {
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
 
        return 0;
 }
index a6ef286..3447ddc 100644 (file)
@@ -364,8 +364,6 @@ static inline void dw_pcie_dbi_ro_wr_dis(struct dw_pcie *pci)
 
 #ifdef CONFIG_PCIE_DW_HOST
 irqreturn_t dw_handle_msi_irq(struct pcie_port *pp);
-void dw_pcie_msi_init(struct pcie_port *pp);
-void dw_pcie_free_msi(struct pcie_port *pp);
 void dw_pcie_setup_rc(struct pcie_port *pp);
 int dw_pcie_host_init(struct pcie_port *pp);
 void dw_pcie_host_deinit(struct pcie_port *pp);
@@ -378,14 +376,6 @@ static inline irqreturn_t dw_handle_msi_irq(struct pcie_port *pp)
        return IRQ_NONE;
 }
 
-static inline void dw_pcie_msi_init(struct pcie_port *pp)
-{
-}
-
-static inline void dw_pcie_free_msi(struct pcie_port *pp)
-{
-}
-
 static inline void dw_pcie_setup_rc(struct pcie_port *pp)
 {
 }
index ece5441..210777c 100644 (file)
@@ -199,8 +199,6 @@ static int histb_pcie_host_init(struct pcie_port *pp)
        /* setup root complex */
        dw_pcie_setup_rc(pp);
 
-       dw_pcie_msi_init(pp);
-
        return 0;
 }
 
index 675b4d8..f84ac1b 100644 (file)
@@ -406,7 +406,6 @@ static int kirin_pcie_host_init(struct pcie_port *pp)
        pp->bridge->ops = &kirin_pci_ops;
 
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
 
        return 0;
 }
index 8eb8ac2..eb10717 100644 (file)
@@ -1281,8 +1281,6 @@ static int qcom_pcie_host_init(struct pcie_port *pp)
        }
 
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
-
        qcom_ep_reset_deassert(pcie);
 
        return 0;
index ebbaa06..31475e4 100644 (file)
@@ -102,16 +102,12 @@ static irqreturn_t spear13xx_pcie_irq_handler(int irq, void *arg)
 
 static void spear13xx_pcie_enable_interrupts(struct spear13xx_pcie *spear13xx_pcie)
 {
-       struct dw_pcie *pci = spear13xx_pcie->pci;
-       struct pcie_port *pp = &pci->pp;
        struct pcie_app_reg *app_reg = spear13xx_pcie->app_base;
 
        /* Enable MSI interrupt */
-       if (IS_ENABLED(CONFIG_PCI_MSI)) {
-               dw_pcie_msi_init(pp);
+       if (IS_ENABLED(CONFIG_PCI_MSI))
                writel(readl(&app_reg->int_mask) |
                                MSI_CTRL_INT, &app_reg->int_mask);
-       }
 }
 
 static int spear13xx_pcie_link_up(struct dw_pcie *pci)
index f7d7b00..84f3e0b 100644 (file)
@@ -765,8 +765,6 @@ static void tegra_pcie_enable_msi_interrupts(struct pcie_port *pp)
        struct tegra_pcie_dw *pcie = to_tegra_pcie(pci);
        u32 val;
 
-       dw_pcie_msi_init(pp);
-
        /* Enable MSI interrupt generation */
        val = appl_readl(pcie, APPL_INTR_EN_L0_0);
        val |= APPL_INTR_EN_L0_0_SYS_MSI_INTR_EN;
index f4b776e..e661640 100644 (file)
@@ -315,7 +315,6 @@ static int uniphier_pcie_host_init(struct pcie_port *pp)
        uniphier_pcie_irq_enable(priv);
 
        dw_pcie_setup_rc(pp);
-       dw_pcie_msi_init(pp);
 
        return 0;
 }