drivers/gpu/drm/radeon/clearstate_cayman.h

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  21  *
  22  */
  23
  24 #include "clearstate_defs.h"
  25
  26 static const u32 SECT_CONTEXT_def_1[] =
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 480     0, // HOLE
 481     0, // HOLE
 482     0, // HOLE
 483     0, // HOLE
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 517 static const u32 SECT_CONTEXT_def_2[] =
 518 {
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 524     0x00000000, // VGT_DMA_BASE
 525 };
 526 static const u32 SECT_CONTEXT_def_3[] =
 527 {
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 529     0x00000000, // DB_EQAA
 530     0x00000000, // CB_COLOR_CONTROL
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1045 };
1046 static const struct cs_extent_def SECT_CONTEXT_defs[] =
1047 {
1048     {SECT_CONTEXT_def_1, 0x0000a000, 488 },
1049     {SECT_CONTEXT_def_2, 0x0000a1f5, 6 },
1050     {SECT_CONTEXT_def_3, 0x0000a200, 55 },
1051     {SECT_CONTEXT_def_4, 0x0000a23a, 99 },
1052     {SECT_CONTEXT_def_5, 0x0000a29e, 5 },
1053     {SECT_CONTEXT_def_6, 0x0000a2a5, 56 },
1054     {SECT_CONTEXT_def_7, 0x0000a2de, 290 },
1055     { NULL, 0, 0 }
1056 };
1057 static const u32 SECT_CLEAR_def_1[] =
1058 {
1059     0xffffffff, // SQ_TEX_SAMPLER_CLEAR
1060     0xffffffff, // SQ_TEX_RESOURCE_CLEAR
1061     0xffffffff, // SQ_LOOP_BOOL_CLEAR
1062 };
1063 static const struct cs_extent_def SECT_CLEAR_defs[] =
1064 {
1065     {SECT_CLEAR_def_1, 0x0000ffc0, 3 },
1066     { NULL, 0, 0 }
1067 };
1068 static const u32 SECT_CTRLCONST_def_1[] =
1069 {
1070     0x00000000, // SQ_VTX_BASE_VTX_LOC
1071     0x00000000, // SQ_VTX_START_INST_LOC
1072 };
1073 static const struct cs_extent_def SECT_CTRLCONST_defs[] =
1074 {
1075     {SECT_CTRLCONST_def_1, 0x0000f3fc, 2 },
1076     { NULL, 0, 0 }
1077 };
1078 static const struct cs_section_def cayman_cs_data[] = {
1079     { SECT_CONTEXT_defs, SECT_CONTEXT },
1080     { SECT_CLEAR_defs, SECT_CLEAR },
1081     { SECT_CTRLCONST_defs, SECT_CTRLCONST },
1082     { NULL, SECT_NONE }
1083 };